TDR(Time Domain Reflectometry)时域反射是一种通用的阻抗测量技术，广泛应用于PCB、FPC、电缆、连接器等领域。随着计算机和通信系统的串行总线速度显著提高，对PCB走线要求越来越高。如果您的电路板操作在1Gbps或以上，电路板只是满足规范的差分阻抗是不够的。在当前和下一代电路板，满足损耗也是重要的规格了。如何验证PCB走线的特征阻抗和传输损耗是否达到设计要求成为了PCB生产商以及高速数字电路设计人员必须关注的问题。

在PCB、FPC设计生产阶段，如何按照设计文档进行阻抗，损耗的合规设计，布局、走线有哪些需要注意的地方，也是持续困扰PCB生产厂商产品前期导入的问题。本次研讨会将邀请行业最大的高速PCB设计公司一搏科技资深专家针对PCB叠层设计，阻抗管控，损耗设计等专项议题进行深入探讨；同时，PCB测试测量领头公司泰克科技及捷泰科技将带来目前最新的阻抗及损耗(SET2DIL,Delta-L)测试原理和方法，以应对不同客户,不同产品的设计，验证需求。

恭候莅临！

泰克科技

2017年8月31日

日程安排

时间

研 讨 会 主 题

演 讲 人

13:00~13:30

来宾签到

13:30~14:30

层叠阻抗与损耗设计原理

一搏科技

14:30~14:45

茶歇

14:45~15:45

TDR阻抗及损耗测量技术

泰克科技

王宏军

15:45~16:45

JTTS PCB高频阻抗测试系统

捷泰科技

17:15~17:30

抽奖

时间地点

主办单位：泰克科技(中国)有限公司捷泰科技(中国)有限公司

会议时间 : 2017年09月28日 星期四

会议地点：深圳宝利来国际大酒店 四楼宴会B厅

会议地址：深圳市宝安区福永街道福永大道1号

如您对我们的安排有任何不清楚的地方请与以下人员联络：

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联 系 人：黄发生（18665886931）

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捷泰科技(中国)有限公司/深圳市捷泰普科技有限公司

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